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加法进位链的手动约束

在激光雷达中，使用FPGA实现TDC时需要手动约束进位链的位置。这里简单记录下。在outflow下会生成一个.qplace文件。用于指示布线的各个原语资源的分布位...

阅读全文2024-05-20

基于FPGA的AES256光纤加密设计案例实现

近年来，信息安全应用于生活中的各个领域.在光通信系统中，往往对速率有着较高的追求。其中对光模块，光纤通信中的传输算法，传输的模式以及光波段...

阅读全文2024-05-10

Altera将AI注入新的中端FPGA

今年2月，英特尔宣布将Altera分拆为一家专注于FGPA的独立公司。拥有40年的血统，Altera的名字在业界肯定是众所周知的。虽然该公司仍由英特尔100%控股，但...

阅读全文2024-05-07

基于FPGA BRAM的多端口地址查找表与FPGA BRAM的资源

在多端口交换机的设计中，交换机的每个端口都会各自维护一张查找表，数据帧进入到交换机后，需要进行查表和转发。...

阅读全文2024-05-01

Xilinx FPGA BGA推荐设计规则和策略（二）

工程师必须在设计阶段早期评估功率需求，以确保有足够的层和面积为需要功率的BGA焊盘提供足够的功率。...

阅读全文2024-05-01

时序约束实操

添加约束的目的是为了告诉FPGA你的设计指标及运行情况。在上面的生成约束之后，在Result àxx.sdc中提供约束参考（请注意该文件不能直接添加到工程中，需...

阅读全文2024-04-28

基于自研芯片+顶级AMD FPGA，西门子EDA发布“快而

电子发烧友网报道（文/吴子鹏）在大型芯片设计过程中，验证被认为是整体流程中最复杂、最耗时的环节之一。有数据显示，目前功能验证约占整个芯片开...

阅读全文2024-04-26

国产FPGA应用专题--易灵思Efinity软件使用心得

做为FPGA的集成开发环境，不同的厂家其实大同小异。很多国产厂家，如安路，高云，会在软件上贴近Xilinx和Intel，以节省客户的软件使用成本。而国产厂商...

阅读全文2024-04-23

易灵思RAM使用--Update4

易灵思RAM在使用时可以会遇到一些问题，这里把常用的问题总结下。 1、ram初始化文件路径是工程路径在对ram进行初始化时需要指定文件路径，这里要注意...

阅读全文2024-04-23

FPGA加法截位处理方法介绍

本模块实现输入与输出位宽相同数据加法，并对结果进行四舍五入截位，对标matlab round函数。...

阅读全文2024-04-18

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